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    应聘硬件工程师或研发类工作资料集锦_硬件工程师_电子工程师_嵌入式工程师_单片机_笔试题目_面试题目-大共享下载网整理

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    应聘硬件工程师或研发类工作资料集锦_硬件工程师_电子工程师_嵌入式工程师_单片机_笔试题目_面试题目-大共享下载网整理

    模拟 电路 (基本概念和知识总揽) 1、 基本放大电路种类 (电压放大器,电流放大器,互导放大器和互阻放大器),优缺点,特别是广泛采用差分结构的原因。 2、 负反馈种类 (电压并联反馈,电流串联反馈,电压串联反馈和电流并联反馈);负反 馈的优点(降低放大器的增益灵敏度,改变输入电阻和输出电阻,改善放大器的线性和非 线性失真,有效地扩展放大器的通频带,自动调节作用) 3、基尔霍夫定理的内容是什么 基尔霍夫定律包括电流定律和电压定律 。 电流定律 在集总电 路中,任何时刻,对任一节点,所有流出节点的支路电流代数和恒 等于零。 电 压定律 在集总电路中,任何时刻,沿任一回路,所有支路电压的代数和恒等于零。 4、描述反馈电路的概念,列举他们的应用 反 馈,就是在电子系统中,把输出回路中的电量输入到输入回路中去。 反馈的类型 有电压串联负反馈、电流串联负反馈、电压并联负反馈、电流并联负反馈。 负反馈的优点 降低放大器的增益灵敏度,改变输入电阻和输出电阻,改善放大器的线性和非线性失真,有效地扩展放大器的通频带,自动调节作用。 电压 (流) 负反馈的特点 电路的输出电压 (流) 趋向于维持恒定。 5、有源滤波器和无源滤波器的区别 无源滤波器 这种电 路主要有无源元件 R、 L 和 C 组成 有源滤波器 集成运放和 R、 C 组成,具有不用电感、体积小、重量轻等优点。 集成运放的开环电压增益和输入阻抗均很高,输出电阻小,构成有源滤波电路后还具有一定的电压放大和缓冲作用。但集成运放带宽有限,所以目前的有源滤波电路的工作频率难以做得很高。 6、基本放大电路的种类及优缺点,广泛采用差分结构的原因。 答基本放大电路按其接法的不同可以分为共发射极放大电路、共基极放大电路和共集电极放大电路,简称共基、共射、共集放大电路。 共射放大电路既能放大电流又能放大电压,输入电阻在三种电路中 居中,输出电阻较大,频带较窄。常做为低频电压放大电路的单元电路。 共基放大电路只能放大电压不能放大电流,输入电阻小,电压放大倍数和输出电阻与共射放大电路相当,频率特性是三种接法中最好的电路。常用于宽频带放大电路。 共集放大电路只能放大电流不能放大电压,是三种接法中输入电阻最大、输出电阻最小的电路,并具有电压跟随的特点。常用于电压放大电路的输入级和输出级,在功率放大电路中也常采用射极输出的形式。 广泛采用差分结构的原因是差分结构可以抑制温度漂移现象。 7、 二极管主要用于限幅,整流,钳位. 判断二极管是否正向导 通 1.先假设二极管截止,求其阳极和阴极电位; 2.若阳极阴极电位差> UD ,则其正向导通; 3.若电路有多个二极管,阳极和阴极电位差最大的二极管优先导通;其导通后,其阳极阴极电位差被钳制在正向导通电压(0 .7V 或0 .3 V );再判断其它二极管. 【 例 1】 下图中,已知 VA3V, VB0V, DA 、 DB为锗管,求输出端 Y的电位,并说明每个 二极管的 作用。 DA –12V Y A B DB R 解 DA优先导通,则 VY3–0.32.7V DA导通后, DB因反偏而截止,起隔离作用, DA起钳位作用,将 Y端的电位钳制在2.7V。 数字电路 (基本概念和知识总揽) 1、 数字信号指的是在时间上和数值上都是离散的信号;即信号在时间上不连续,总是发生在一序列离散的瞬间;在数 值上量化,只能按有限多个增量或阶梯取值。(模拟信号指在时间上和数值上都是连续的信号。) 2、 数字电路主要研究电路输入、输出状态之间的相互关系,即逻辑关系。分析和设计数字电路的数学工具是逻辑代数 ,由英国数学家布尔 1849 年提出,因此也称布尔代数。 3、 逻辑代数有三种最基本的运算与、或、非。基本逻辑的简单组合称为复合逻辑。 4、 逻辑代数三个基本规则代入规则、反演规则和对偶规则。 5、 化简电路是为了降低系统的成本,提高电路的可靠性,以便使用最少集成电路实现功能。 6、把若干个有源器件和无源器件及其导线,按照 一定的功能要求制作在同一块半导体芯片上,这样的产品叫集成电路。最简单的数字集成电路就是集成逻辑门,以基本逻辑门为基础,可构成各种功能的组合逻辑电路和时序逻辑电路。 7、 TTL 门电路是目前双极型数字集成电路使用最多的一种,由于输入端和输出端的结构形成都采用了半导体三极管,所以也称晶体管 -晶体管逻辑门电路。 TTL 与非门是 TTL 门电路的基本单元。最常用的集成逻辑门电路 TTL 门和 CMOS 门。 问题集锦 1、同步电路和异步电路的区别是什么 同步电路存储电路中所有触发器的时钟输入端都接同一个时钟脉冲源,因而所有触 发器的状态的变化都与所加的时钟脉冲信号同步。 异步电路电路没有统一的时钟,有些触发器的时钟输入端与时钟脉冲源相连,这有这些触发器的状态变化与时钟脉冲同步,而其他的触发器的状态变化不与时钟脉冲同步。 2、什么是 线与 逻辑,要实现它,在硬件特性上有什么具体要求 将两个门电路的输出端并联以实现与逻辑的功能成为线与。 在硬件上,要用 OC 门来实现,同时在输出端口加一个上拉电阻。 由于不用 OC 门可能使灌电流过大,而烧坏逻辑门。 3、解释 setup和 hold time violation,画图说明,并说明解决办法 。 Setup/hold time 是测试芯片对输入信号和时钟信号之间的时间要求。建立时间是指触发器的时钟信号上升沿到来以前,数据稳定不变的时间。输入信号应提前时钟上升沿(如上升沿有效) T 时间到达芯片,这个 T 就是建立时间 -Setup time.如不满足 setup time,这个数据就不能被这一时钟打入触发器,只有在下一个时钟上升沿,数据才能被打入触发器。 保持时间是指触发器的时钟信号上升沿到来以后,数据稳定不变的时间。如果 hold time 不够,数据同样不能被打入触发器。 建立时间 Setup Time和保 持时间( Hold time)。建立时间是指在时钟边沿前,数据信号需要保持不变的时间。保持时间是指时钟跳变边沿后数据信号需要保持不变的时间。如果数据信号在时钟沿触发前后持续的时间均超过建立和保持时间,那么超过量就分别被称为建立时间裕量和保持时间裕量。 4、什么是竞争与冒险现象怎样判断如何消除(汉王笔试) 在组合逻辑中,由于门的输入信号通路中经过了不同的延时,导致到达该门的时间不一致叫竞争。 产生毛刺叫冒险。 判断方法 代数法、图形法(是否有相切的卡诺圈)、表格法(真值表)。如果布尔式中有相反的信号则可能产 生竞争和冒险现象。 解决方法一是添加布尔式的消去项 ; 二是在芯片外部加电容 ;三是加入选通信号。 5、名词 SRAM、 SSRAM、 SDRAM( SRAM静态 RAM; DRAM动态 RAM; SSRAMSynchronous Static Random Access Memory 同步静态随机访问存储器。它的一种类型的SRAM。 SSRAM 的所有访问都在时钟的上升 /下降沿启动。地址、数据输入和其它控制信号均于时钟信号相关。这一点与异步 SRAM 不同,异步 SRAM 的访问独立于时钟,数据输入和输出都由地址的变 化控制。 SDRAM Synchronous DRAM 同步动态随机存储器 6、 FPGA 和 ASIC的概念,他们的区别。(未知) 答案 FPGA 是可编程 ASIC。 ASIC专用集成电路,它是面向专门用途的电路,专门为一个用户设计和制造的。根据一个用户的特定要求,能以低研制成本,短、交 货周期供货的全定制,半定制集成电路。与门阵列等其它 ASICApplication Specific IC相比,它们又具有设计开发周期短、设计制造成本低、开发工具先进、标准产品无需测试、质量稳定以及可实时在线检验等优点。 7、单片机上电后没有运转,首先要检查什么 a、 首先应该确认电源电压是否正常。用电压表测量接地引脚跟电源引脚之间的电压,看是否是电源电压,例如常用的 5V。 b、 接下来就是检查复位引脚电压是否正常。分别测量按下复位按钮和放开复位按钮的电压值,看是否正确。 c、 然后再检查晶振是否起振了,一般用示 波器来看晶振引脚的波形 ; 经过上面几点的检查,一般即可排除故障了。如果系统不稳定的话,有时是因为电源滤波不好导致的。在单片机的电源引脚跟地引脚之间接上一个 0.1uF的电容会有所改善。如果电源没有滤波电容的话,则需要再接一个更大滤波电容,例如 220uF的。遇到系统不稳定时,就可以并上电容试试(越靠近芯片越好 )。 8、什么是同步逻辑和异步逻辑(汉王笔试) 同步逻辑是时钟之间有固定的因果关系。异步逻辑是各时钟之间没有固定的因果关系。 9、你知道那些常用逻辑电平 TTL 与 COMS 电平可以直接互连吗(汉王笔试) 常用逻辑电平 12V, 5V, 3.3V; TTL 和 CMOS 不可以直接互连,由于 TTL 是在 0.3-3.6V之间,而 CMOS 则是有在 12V的有在 5V的。 CMOS 输出接到 TTL 是可以直接互连。 TTL接到 CMOS 需要在输出端口加一上拉电阻接到 5V或者 12V。

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