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    基于FPGA的高速异步FIFO的设计【原创资料下载】

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    基于FPGA的高速异步FIFO的设计【原创资料下载】

    本科学生毕业论文(设计) 题 目 中 文 基于 英 文 of 名 李卫 学 号 200806002118 院 (系) 电子工程系 专业、年级 电子信息工程 2008 级 指导教师 包本刚 2012年 5 月 8 日 湖南科技学院本科毕业论文(设计)诚信声明 本人郑重 声明所呈交的本科毕业论文(设计),是本人在指导老师的指导下,独立进行研究工作所取得的成果,成果不存在知识产权争议,除文中已经注明引用的内容外,本论文不含任何其他个人或集体已经发表或撰写过的作品成果。对本文的研究做出重要贡献的个人和集体均已在文中以明确方式标明。本人完全意识到本声明的法律结果由本人承担。 本科毕业论文(设计)作者签名 二 0一 二年 月 日 A 毕业论文(设计)任务书 课题名称 基于 学生姓名 李卫 系 别 电子工程系 专 业 电 子信息工程 指导教师 包本刚 2011 年 11 月 30 日 B 湖南科技学院本科毕业论文(设计)任务书 1、主题词、关键词 异步 亚稳态 格雷码 2、毕业论文(设计)内容要求 一、本异步 1. 读写时钟分别可达 100 2. 8位的数据宽度 3. 1024字节的深度 4. 能产生正确的空 /满信号 为了实现以上的要求,我采用了地址自增计数的方式,并转换为格雷码作为读写指针,尽最大程度减少亚稳态发生的概率。最后采用 二、在以上设计要求的基础上,优化代码,优化综合条件,进一步提高异步 达到高速目的。 C 3、文献查阅指引 [1] e [2] [3] [4] [5] 543[6] 998,68. [7] [8] 于海 ,樊晓桠 步 研究与实现 [J]2007,243210[9] 夏宇闻 字系统设计教程 2008. [10] M]清华大学出版社 ,4、毕业论文(设计)进度安排 2011 年 9 月 28 日 2011 年 11 月 15 日收集有关方面的资料; 2011 年 11 月 16 日 2011 年 12 月 5 日在对资料充分研究的基础上,提出可行的设计方法; 2011 年 12 月 6 日 2012 年 5 月 10 日通过对系统的仿真测试;并从硬件实物上给于证明; 2012 年 5 月 15 日 2012 年 5 月 20 日论文总结

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